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一种基于动态共栅放大器的2阶噪声整形SAR ADC设计,通过电荷倍增和动态bulk开关机制优化噪声整形性能,并采用PVT跟踪脉冲生成器提升工艺电压温度适应性,实现76dB SNDR、0.0045mm²面积和31.5uW功耗。
由于可穿戴设备和物联网(IoT)系统中板空间和电池容量的限制,对于具有强大性能且能在PVT变化下保持高效工作的紧凑型ADC的需求正在增长。噪声整形SAR ADC因其能够在保持低功耗的同时实现高分辨率而成为有前景的候选方案。如图1所示,通过将delta-sigma调制技术集成到SAR ADC中,NS-SAR结合了两种架构的优点。一方面,NS-SAR继承了SAR ADC的功耗高效数字式架构;另一方面,噪声整形提高了有效比特数(ENOB),从而缓解了传统SAR ADC设计中的噪声和面积限制。此外,由于采用了多比特量化器,NS-SAR只需要处理较小的残差信号,放宽了环路滤波器的设计约束(如线性要求),因此无需使用传统delta-sigma调制器中耗电较大的闭环运算跨导放大器(OTA)。
NS-SAR ADC的基本框架。
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